---

با توسعه روز افزون ارتباطات نسل های جدید که به امتداد حضور استانداردهای قبلی در دوران تکامل تدریجی خود بسر می برد، بکارگیری مدارات گیرنده چند استانداردی گزینه ای مطلوب برای صرفه جویی در توان و مساحت محسوب می گردد. بدلیل ضعف نسبی تکنولوژی های جدید زیر دهم میکرومتر در ساخت مدارات مجتمعCMOS نوع آنالوگ، طراحی بخش های مختلف گیرنده های چند استانداردی قابل تنظیم خصوصا در قسمت پیشانی گیرنده های مخابرات بی سیم از چالش های جدی می باشد. در این تحقیق، ساختار یک مدولاتور دلتا سیگما قابل پیکر بندی مجدد بعنوان یکی از قسمت های کلیدی مدارات پیشانی گیرنده چند استانداردی مطالعه، طراحی، توسعه و شبیه سازی شده است. در طراحی مدولاتور مذکور از سه ایده نوین برای کاهش توان مصرفی به تناسب استاندارد مورد نیاز کاربر استفاده شده است. در تکنیک اول تعداد تقویت کننده های(آپ امپ) لازم برای افزایش درجه مدولاتور کاهش یافته و با استفاده از تکنیک بهبود شکل دهی نویز، یکی از آپ امپ ها با مقایسه کننده حلقه مشترکا بکار گیری شده است، در تکنیک دوم با تغییر توابع تبدیل سطح سیستم و انتقال نقطه جمع کنندگی در پیاده سازی ساختار مسیر مستقیم(FF ) به ورودی طبقه ماقبل از مصرف توان و محدودیت سرعت گلوگاهی جمع کننده اجتناب شده است، و نهایتا با بکار گیری ساختار هببریدی بطوریکه پیاده سازی طبقه اول زمان پیوسته و طبقات بعدی بصورت زمان گسسته باشد، از نیازمندی مصرف توان مدار نمونه بردار و تقویت کننده گره تفریق گر ورودی مدولاتور، بطور قابل ملاحظه ای کاسته خواهد شد. شبیه سازی سطح سیستم ساختار پیشنهادی چند استانداردی با قابلیت پیکربندی جدید، نشان دهنده بهبود قابلیت مدار و بر آورده کردن مشخصات سه استاندارد نمونه GSM، WCDMA و WLAN با نوید توان مصرفی کمتر در مقایسه با موارد مشابه قبلی می باشد.